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【适用人群】/ A1 e4 O' n& Q; W/ I
本开发板还适用于计算机专业和电科类专业的本科生、研究生、博士生、IC集成电路/ IP CORE前期设计验证、全国相关各科研院所，如计算机科学、微电子、通信、测控技术与仪器设计、电子工程、机电一体化、自动化等相关专业；航天部、电子部、图象/ 通讯研发……
g8 ~# P" d) m* D- z5 ]同时，这套开发板也提供了一个SOPC（System On Programming Chip）平台，可以实现嵌入式的软CPU，如NIOSII ，Open RISC等，为嵌入式电子产品设计提供了又一种选择。/ v1 R2 F4 ^( e: _
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- m- c2 l/ ]: ?) b$ _- {
' H/ o+ L/ i3 ~% \2 Y3 t, V7 ~
【RCIII-CY2C35核心板硬件配置】
( Q Y5 \4 B! Z4 u 采用6层板工业标准精心设计：" [. r* E4 n! _6 N8 j
8 e! p$ v. J3 I 1。FPGA芯片： EP2C35F484" J+ A& _9 \& @, @8 z
芯片特性 EP2C35F484C8
& t+ V' U" V# }2 D" ~ LEs 18,752 33,216
( F3 U( v9 H: D% N2。配置芯片：CPLD+FLASH: 支持多配置文件选择配置, \+ ~5 ]! q6 R" w& D4 ^
3。最大支持16MBx16bit高速SDARM两片 K1 ^# O+ s$ D7 H7 I7 a- t
两片SDRAM并联，形成32位带宽 ，最高166MHz读写速度；, e) ^' ]) i3 T6 K7 ?5 H
4。 8MByte快速FLASH: c' h# M9 X/ `
支持最大单片 8M×8Bit 读写速度为90ns；% U) \6 K4 n+ f1 v9 S
灵活的页面方式，可以用来存储FPGA配置文件或者操作系统镜像文件；8 m; `* h5 d" M7 }. n, y
5。配置CPLD
; e0 ~2 ?$ U2 k* N! w# v采用EPM240T100C5，产生配置时序在上电时对FPGA进行配置
% D) V, O% @. q1 L" B' |$ S
, |' x/ P# L, O& H【红色飓风III代多功能底板硬件配置】
+ Q: r7 |0 D% `& w& \ 采用4层板工业标准精心设计：
: d1 g! U% e! k5 J( x
$ s0 V8 M8 }; b# s6 V: E 1。视频输入接口
5 |8 T- N! [5 m8 Y, x4 @4 O, u采用最流行的视频解码芯片SAA7113来实现视频采集接口，支持Cvbs和S-Video（Y/C分量）两种常用的视频输入信号，输出为标准的ITU 656数据流,YUV 4:2:2格式。设计实例提供了Cvbs视频和S-Video视频采集的配置方法,通过SignalTapII工具可以观察详细的数据格式和时序.
) O+ x8 j$ Q4 s- L4 b' r2。视频输出VGA接口
$ E- b9 @, W; x+ A' ^Analog Device公司的VGA DAC ADV7125，和FPGA间接口为标准的数字VGA接口，支持16Bit的RGB565格式，同时B通道可配置为8bit输入模式.8 ?9 B5 Q, ?( ?& B/ L- E2 A
3。USB2.0高速数据接口9 t' r) V _% |# g1 B- p
采用了应用广泛，性能稳定的Cypress公司CY68013芯片实现了USB接口的扩展，能够与计算机之间实现高速的数据传递.提供了完整的设计实例,实现USB接口的读,写和读写双向操作,提供完整的主机上的VC++源代码和FPGA上的HDL源代码.3 R9 n$ r% S$ ]: B; a6 C
4。音频接口
, E1 p. T9 M( q7 C% i( M0 c/ S采用了TLV320AIC23这款TI公司生产的高性能立体声音频编解码器，该芯片同时高度集成了模拟电路功能.TLV320AIC23中的模数与数模转换器使用了多比特，Sigma一delta工艺，并在内部集成了高采样率的数字内插滤波器。该器件的数字传输字长可以是16, 20,24, 32bit，它支持8－96Wz的采样率。提供模数转换器的sigma－delta调制器决定了其三阶多比特结构，这种结构在采样率为96kRz的情况下能够达到 90dB信噪比、从而可在小型低功耗设计中实现高保真录音
8 J2 w0 ~: M2 q9 M7 g: U' Y 设计实例提供了音频芯片的配置方法以及一个输入输出环路的功能实现.9 Y+ x$ f, M( l! d
5。9针RS－232 串口# d% \% \2 r2 t! {$ x0 o5 u" V
RS232是应用最为广泛的UART接口,可以方便的实现与计算机的数据通讯；: J+ C: G. A' _* t
同时在调试基于FPGA的嵌入式操作系统时候,可以作为辅助调试接口，结果输
' T2 b* p2 s, u! [出到主机的超级终端上面.$ T J, Z% { r
6。PS/2鼠标，键盘接口, u; d5 y3 K3 [4 V! D J: ?9 E
标准的鼠标、键盘接口，支持3.3V和5V设备，可以用来验证PS/2的接口协议，实现一个IO设备扩展；' a. a' K7 c/ {' S2 L
7。10M以太网RTL8019接口 i. C. z. e* ^& n# e
采用realteck公司推出多年RTL8019AS网络芯片。RTL8019AS芯片是一款应用广泛的10M网络芯片，支持以太网II 和 IEEE802.3 10Base5，10Base2，10BaseT、支持可编程输出的4－诊断 LED。利用rtl8019as可以在niosII系统中方便的建立起完整的网络服务器，可以通过网络从FPGA芯片构成的软嵌入式系统中收发数据。
) k6 ?1 p% d* Q# v 8。各种基础输入输出设备9 F' x {" y$ C2 ?
16x2标准字符型液晶模块7 ^) M2 L1 i9 x. O+ w
4位七段数码管
1 C; L- H6 ?/ J1 f, P; ]. s8 X 8位发光LED管
; E' m2 S( W; C0 }* W 蜂鸣器# G- Z! p" B# ]# g/ F
8位按键& V$ d3 L. c5 `
8位波码开关; ~ O! A1 K p+ _+ A
. A' S- `# T9 F7 t
【配套软件】
& r3 y7 n. l- f3 _' G% ]3 f1。NiosII开发工具，包括; N$ J" L' T6 A* U5 @- G5 v
>NisoII 集成开发环境（IDE 5.0）
: s( _* s0 x, M3 i. B >NisoII 集成开发环境（IDE 6.0） ( ]0 V) |" z. W' h" X+ W. v- _
>GNU工具+ O# o v% i# k. f
>NiosII指令仿真器（ISS）
( _ Y5 ]6 a; x5 p7 c2。带有开发许可的Micro uC/OS-II实时操作系统及其uCLinux Boot a9 W# [; F2 P3 I2 D: y
3。LightWeightIP TCP/IP堆栈
6 U3 S& `. z+ e7 O8 a4。QuartusII设计软件，5.0版 + SP2补丁，支持全系列CycloneI/II芯片；
# W& _9 o% @8 R2 q9 ?8 ?2 O9 u5。QuartusII设计软件，6.0版 ，支持全系列CycloneI/II芯片；$ f) x# a/ k9 o( C' @
6。SoPC Builder标准微处理器外设库 3 g6 T- w) k. _8 F/ L* s6 T
7。Microtronix NiosII Linux开发包，1.4版本，支持QuartusII5.0和NIOSII 5.03 F w( M7 N3 D' T
8。FPGA/ASIC设计资源，超过1GB的参考资料) s: T5 W( ^" l. k$ H4 M. z
9。所有接口控制器源代码，实验程序原代码; K) z3 n! B! \* |
10。实验指导书，用户手册等% B$ i2 C+ ^8 Y/ f+ u8 M
【设计文档】; k1 F2 F, k2 r& k4 m
1。开发板用户手册
5 [: m: ~, [! t# ]+ F3 J# W2。开发板原理图（pdf格式）3 G% Z w, T# n: w! V' \( a
3。 QuartusII和NIOSII IDE安装指导和入门教程
( `4 }$ {8 y3 U+ R/ l4。Verilog HDL/VHDL教学实验指导手册7 x0 s! v4 k3 N ^8 ]4 j2 P$ D5 N
5。NIOSII嵌入式系统L教学实验指导手册# z; |+ d9 j* x: Y0 Q+ Y
6。Modelsim软件使用教程
- @5 [" B. g7 B* M7。华清远见FPGA培训视频与培训资源
. `' k* k- X* ]" x2 |8。主要芯片的数据手册和仿真模型（HDL语言描述模型，用于系统仿真）
& G: |, w$ t# M5 d【HDL硬件设计开发实例】
. ~2 _6 G) {, a# e$ N: \RED CYCLONE 开发板RCIII-CY2C35 VERILOG程序设计 开发实验1
( r% Z% Y3 c( ` r v8 D前言2( e* R# A% g% }# q4 s
目录35 Z& G1 A" y2 C3 ^6 P
CHAPTER 1 ALTERA QUATUSII 5.0使用介绍6
8 U6 F3 r6 k8 Q" g e% s1 QUATUSII 设计过程6! y% e) O m9 S. k! E5 C4 M
2 软件操作界面7' ?3 ]( z" ?1 S
3 建立工程9; `0 R5 C3 t+ }% H/ i3 h2 j! m
4 建立设计11" c- l- d2 j. I, }
4.1使用QUATUSII BLOCK EDITOR 建立原理图文件13
" ^9 J7 h5 a; v: h! K/ P4.2使用 QUARTUS II TEXT EDITOR13
* R) q) U0 Y3 Y% \9 m9 G4.3使用 QUARTUS II SYMBOL EDITOR14
1 n6 {( F& O' n1 J& e g. I. {4.4使用 VERILOG HDL、VHDL 与 AHDL143 {0 D' p! {/ o
4.5使用ALTERA 宏功能模块14
5 }+ I7 C5 ?' O4 S3 H5 编译综合设计15( [5 f) L: s g* Q$ G" [" P" V; f/ D
6 分配设备与管脚21' o% h; l8 H0 n. k9 Q
7 程序下载24& j& w5 ]* j+ {: H
8 调试与软件逻辑分析仪的使用25
' z# R, g6 F5 G4 Z. u8.1设置和运行 SIGNALTAP II 逻辑分析器25
% S3 X$ o2 y7 V' T( i8.2 设置触发器26; I3 x0 g& Z7 ] X+ z6 P+ w' N
CHAPTER 2 数字电路与数字系统实验28
, M' \, U+ U9 q# \) o: G实验一 通过蜂鸣器播放歌曲（熟悉开发环境与流程）28
. q7 ~2 v5 Z$ F1 m6 t5 d实验二 3/8 译码器41
% R+ A6 U5 h5 w实验三 分频器43" k# L2 m* Y7 M% c! s6 @( z
实验四 七段数码显示器设计45+ A8 C) H \+ D# h
实验五 基于LPM核的正弦函数发生器47* |6 U$ Y0 F# D/ K
实验六 LCD显示实验62
% C$ A; N- j- q; _' B实验七 RS-232串口控制器65
, e" u# i+ \& [- }7 f& ?实验八 VGA控制输出实验69
+ L. w5 a+ m5 ^% `% i实验九 PS/2键盘控制器实验71
0 q2 j. @9 u# g P6 S; N实验十 接口互连实验76
}7 f* f5 C9 H0 r4 P# o9 D扩展性实验 练习使用LOGIC LOCK功能78. g+ w' o. ]$ U$ g
扩展性实验 SDRAM控制器的实现85* l' \$ X+ @) |9 o, ^
扩展性实验 SAA7113视频解码芯片程序设计97, a$ ~0 _# ~8 E/ s3 _/ M) o
【NIOSII设计开发实例】
3 O# ?6 v* d! J1 u+ ]第一部分 NIOSII使用说明 2% _% z* t6 t! C
1 NIOSII 介绍 2- T" a4 s4 e4 \2 F
2 NIOSII 设计流程 6
5 g: _: D8 e: j/ h6 l' j+ A$ d' s第二部分 NIOSII上机实验 9
/ U6 B3 u" P t实验一 NIOSII 开发流程实例---LED显示 9' c5 Q. s/ U. z6 N. u! I
实验二 标准NIOSII硬件系统的组建 36' N* r0 `1 P1 j$ ~. B& b Y
实验三 实现UART— JTAG主机与FPGA之间的通信 461 f) ^% {4 }5 }6 g, }
实验四 SYSTEM ID 实验 49
7 C' i7 W1 t4 R$ [实验五 实现串口通信 51- }: W' d6 M: E+ K( C
实验六 实现LCD显示 55
- H/ e6 u, O/ @" l实验七 按键触发与计数器 57
5 p* r5 l+ V+ U实验八 简单数字钟 60
$ B* Q( Q: j! o9 `" L试验九 FLASH功能测试实验 62
$ S( o$ @9 h5 w实验十 NIOSII综合实验
# o) n0 n2 s2 g2 R1 x【IP Core设计开发实例】$ U: l d8 Y1 _2 y
1。彩色空间变换YCbCr2RGB(RIC－V01）
7 M. Y5 X. J2 ]2 H q. j2。RS编码器（RIC－C01）
2 \1 T+ \ a* V3。SDRAM控制器(RIC-M01)
6 v) p7 n( r/ T- o: W& U6 e8 L$ g! j6 Y# x# J( p" B3 n
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5 A d, X6 U+ V F1 K4 A2 ` w7 K0 S+ `1 Z7 x● 更详细的资料请电话联系索取！
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5 V. C$ x+ t, P/ m0 j
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$ b9 L7 M8 ?6 Y8 m4 V- a7 U特别声明：7 J2 _( g6 p: c3 B+ Q n3 j' E$ @
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QQ:349646210 (dz51验证) MSN:dz51.com@163.com |
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狗仔卡
发表于 8.11.2007 03:47:45
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