PCI&LVDS产品开发平台(RPDP-PCI&LVDS)

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【产品价格】
% e8 S2 _2 i/ [5 v  b 标准版: ￥2500

, ^# v" F9 S  O3 I/ E【产品定位】
( l8 A0 S9 k- G% T1 b2 s+ y基于PCI的高速数据采集卡开发
基于LVDS接口的高速数据采集处理卡；
算法加速卡;


【产品特色】
3 [5 y5 n2 |- P; B+ v3 n2 M提供完整的FPGA+PCI解决方案，性能稳定,兼容性好；
提供完整的参考设计,包括FPGA代码,驱动程序,应用程序等,可以作为项目开发的模板;
! C2 ^8 w: u7 N7 x扩展性能好，可以扩展音频输入输出卡，视频输入输出卡，高速AD，DA等。
/ N+ g8 {0 G2 N: q$ R
" Q, p7 A/ g$ R
/ m5 d8 j+ t& B! }【产品清单】
' p: Q4 Q, e9 T1、RPDP-PCI&LVDS开发板       1块
2、ByteBlasterII 下载电缆    1条
3、配套DVD光盘               1张

2 h; t! A4 ]! \* e
" r# p. s* n! B  b6 w, g) E【硬件资源】
8 N8 m  [- m. V, @9 t+ K+ b1、FPGA芯片：
" s5 J3 b9 Y, O$ I      标准版：EP1C6Q240， 包括12,060LEs，相当于15万门左右
* h# D& c3 [& o8 G- t      增强版：EP1C12Q240，包括12,060LEs，相当于30万门左右
) z' Y- H# q1 I4 P2、配置芯片：
# S5 B9 v. o% z7 L5 o      增强版：EPCS1，1Mbit储存量，支持AS和JTAG两种配置模式
      增强版：EPCS4，4Mbit储存量，支持AS和JTAG两种配置模式
3、8M Byte 高速SDARM
) e, f4 f- U$ z5 ^6 L2 }      一片2M×32Bit SDRAM ，4个Bank，最高166MHz读写速度；
: N9 u) O% I; ]. @2 ]2 v4、LVDS扩展接口（DB62接口）
6 G" r& k5 n0 c( X( P2 j2 }      同时提供提供：
. d2 e; p" G( ~! t" q      12路LVDS信号输出；
0 A3 q3 i  u* l# X0 L# x. ]      12路LVDS信号输入；
0 d3 k- j0 D' W, D      12路LVTTL信号（输入输出可编程）

( k7 `1 V# K( A" w9 [. N5、RedLogic扩展接口（VME48接口）
) }- Q+ H" r3 c) G  {6 ^! r      提供32路LVTTL信号，其中包括一路专用时钟输入和一路专用时钟输出.通过相应的扩展板，可以实现Video，Audio和高 速AD/DA等应用。用户也可以开发自己定义的接口板。
9 e3 f& M0 ?' n$ T! ?/ n
1 y  j! P$ P, F; }2 D- T+ x( y【配套软件】
- Y( s" `( h$ ]8 S8 y$ R" o6 s; G1、 相关开发工具软件
" I9 }4 Q1 P7 N# P/ E6 @+ f* P2、 开发实例及文档
3、 FPGA和ASIC设计资源库
4 O+ ~# @& C+ g, Y! I4 A) d
, h/ G/ q% e- E3 {$ {) d2 q' W9 Y% l【设计文档】
1、开发板用户手册
2、开发板原理图和PCB（Protel99SE格式）
% c  S) @! }$ z) b2 k. h( j3、QuartusII和NIOSII IDE安装指导和入门教程
" |, j- Y' P- Z* v' @! `4、主要芯片的数据手册和仿真模型（Verilog HDL语言描述）
0 [% @/ s/ S! q/ h, H+ a
) o' |8 m+ }3 @$ G, }8 M【开发实例】
) S/ L3 p7 y- w% Z ● BASE64解码算法
        Base64编码
        Base64是网络上最常见的用于传输8Bit字节代码的编码方式之一，大家可以查看RFC2045～RFC2049，上面有MIME的详细规范。
. n5 \8 G2 R6 @4 |& H$ F( ]! R        Base64要求把每三个8Bit的字节转换为四个6Bit的字节（3*8 = 4*6 = 24），然后把6Bit再添两位高位0，组成四个8Bit的字节，也就是说，转换后的字符串理论上将要比原来的长1/3。
! K7 u+ f( J8 x        本设计完成了BASE64解码算法的FPGA程序设计和验证。

● 数据采集卡
        FPGA内部产生数据源，主机端程序响应pci卡发出的中断信号，将硬件板卡中的数据传入主机，并将数据在界面上显示相应的数据以及接收到的帧数。将收到的数据存入硬盘，以便查看。


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) e8 }: G+ V! e- e: h7 c$ M
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