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PCI&LVDS产品开发平台(RPDP-PCI&LVDS)

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发表于 10.11.2007 09:12:42 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
【产品价格】. h) }2 y8 t: h0 E7 ?
标准版: ¥25008 W! y4 P1 j. b0 w' j$ c& @
6 k3 @: r5 l: \4 [4 B3 u9 |
【产品定位】5 \* F- f$ i1 t# L
基于PCI的高速数据采集卡开发
) R/ r, s( ]* t) _- Y基于LVDS接口的高速数据采集处理卡;7 U. `! x: N& [( n& T  u
算法加速卡;
9 U) W- ?) u; |3 r; P8 d2 f% u- ?9 k4 c4 P& V* O! _* p" y& l

# m; t) q, ]5 e$ a【产品特色】% p% T! |# c- W
提供完整的FPGA+PCI解决方案,性能稳定,兼容性好;
# {8 q) K- x/ m0 P8 ~! A8 G提供完整的参考设计,包括FPGA代码,驱动程序,应用程序等,可以作为项目开发的模板;" O( Q) g( u6 W& r' p, |, v) C, W
扩展性能好,可以扩展音频输入输出卡,视频输入输出卡,高速AD,DA等。5 O* Q. s4 r+ d0 N2 }0 n
* U$ ~+ V* V! ?
9 _4 [) a# b( }
【产品清单】
2 X4 Q5 j8 T% a8 \1、RPDP-PCI&LVDS开发板       1块
. N- v* x2 T) [+ Z1 O2、ByteBlasterII 下载电缆    1条
0 o3 C- h5 X  A3、配套DVD光盘               1张
+ X) h4 k* S. A8 P4 j, V5 A" ^
2 O1 w+ W2 c* o$ W' V3 x# l+ }! W8 R
, F$ v7 U) `2 y【硬件资源】
5 r# q) H& o. ~1、FPGA芯片:6 H& l) Q: c9 p* L+ l- N
      标准版:EP1C6Q240, 包括12,060LEs,相当于15万门左右
; e8 L) ]7 p5 E3 |5 z, G1 z      增强版:EP1C12Q240,包括12,060LEs,相当于30万门左右
) ^0 g  h) M* \" S& z1 N2、配置芯片:+ y8 b- H: J0 S- x) p# [
      增强版:EPCS1,1Mbit储存量,支持AS和JTAG两种配置模式
1 V9 T& X9 Q+ p9 m# Q9 Z$ d2 |& {! V      增强版:EPCS4,4Mbit储存量,支持AS和JTAG两种配置模式/ N) i9 C) G5 s7 O0 \; V  {7 B
3、8M Byte 高速SDARM
9 ^* E; Q1 C  H, K4 G$ q      一片2M×32Bit SDRAM ,4个Bank,最高166MHz读写速度;( G8 j1 ]# S* z( Z# N$ Y' H1 ?
4、LVDS扩展接口(DB62接口)) C$ L" n3 |7 S9 y+ x! j
      同时提供提供:
' d9 h8 y" j: ]      12路LVDS信号输出;
7 w' q# F" t9 C' y7 ?3 [1 [      12路LVDS信号输入;
7 Q3 @1 R; v/ q& g% k! V, O      12路LVTTL信号(输入输出可编程)& T& I: ?  W7 o" K

8 Y, b9 c( E7 c1 v! ?4 R5、RedLogic扩展接口(VME48接口)
" k8 U' z5 M% q& P      提供32路LVTTL信号,其中包括一路专用时钟输入和一路专用时钟输出.通过相应的扩展板,可以实现Video,Audio和高 速AD/DA等应用。用户也可以开发自己定义的接口板。
$ R. b% Y( j& W: e6 V7 J! H
1 a5 V2 T& l- C' q8 {; y【配套软件】
( E/ ^' S8 T+ d5 P& ^5 S7 B% E( Y1、 相关开发工具软件! V4 q  @% T7 A3 }7 r: b
2、 开发实例及文档
6 @7 h6 [9 _, ~9 ?6 \3 D3、 FPGA和ASIC设计资源库9 y4 w8 s2 R4 b/ w( P

4 D; x  G. ~, ?4 |/ G7 r5 d* ]【设计文档】
. t' \* [, B: r6 h6 A3 X2 k1、开发板用户手册& C; G1 S% R  }2 }) m: I
2、开发板原理图和PCB(Protel99SE格式)8 v! k3 h  I% J2 W& B9 A0 Y4 p
3、QuartusII和NIOSII IDE安装指导和入门教程
! G! K: F$ w& E7 C0 c! d- X4、主要芯片的数据手册和仿真模型(Verilog HDL语言描述)5 m; j$ o" p' q1 O5 v% A: }  }
4 A7 N3 }, f, s; E6 w5 y. ]
【开发实例】
9 Z$ b7 F% o# l4 \: ~ ● BASE64解码算法
* _, S9 _7 J' H0 |+ B2 Z1 Z, P        Base64编码 7 I* D1 C( q* ~# G- p
        Base64是网络上最常见的用于传输8Bit字节代码的编码方式之一,大家可以查看RFC2045~RFC2049,上面有MIME的详细规范。/ X. p0 e5 \# p, p1 K1 P
        Base64要求把每三个8Bit的字节转换为四个6Bit的字节(3*8 = 4*6 = 24),然后把6Bit再添两位高位0,组成四个8Bit的字节,也就是说,转换后的字符串理论上将要比原来的长1/3。" b5 a  j5 @# S9 j; k
        本设计完成了BASE64解码算法的FPGA程序设计和验证。% Y+ {* `- {5 u1 I
+ @# a2 }+ B  S" q- D+ p8 r
● 数据采集卡7 o. E) W3 R+ L5 k6 r- a! m0 S
        FPGA内部产生数据源,主机端程序响应pci卡发出的中断信号,将硬件板卡中的数据传入主机,并将数据在界面上显示相应的数据以及接收到的帧数。将收到的数据存入硬盘,以便查看。# ~) V- @6 ^) m! Y1 j  m( S
, b( V' V% R8 t+ F( N

9 l8 G  S) D: F- a
# c( _! n. g4 s' V: O5 l5 k. t# R) l/ e: W+ `2 |6 K) a: ^& m

3 f$ X' z- ?$ B1 m1 f; m0 B; z* M6 ]+ ?# F1 P8 n

7 C/ Y5 j" H6 O- `特别声明:
( l* V; ], ~+ ~     由于近期网络邮购部定单火爆,有很多电话咨询担心网络邮购的安全可靠,故本站发表声明如下!9 W& S2 p+ Y; E: F0 \; v+ }( R" v
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电话:   010-51299598  62535108-11      FAX:010-62538108-17
* M& i. L' a1 N7 v         010-82625208        手机:13671276968  
, r" h, s* S: e; f) d 公司门市地址:北京市海淀区中发电子大厦2楼2112柜台
+ U" |; T0 y: S/ u网址: http://www.dz51.cn   http://www.dz51.com     - P8 ]4 A- m. |# o/ `* x9 F
E-Mail:  dz51.com@163.com   dz51123@sohu.com   dz51123@sina.com   sunjingyun488@sohu.com
' E8 ^2 B! R1 f7 j# A7 _QQ:349646210 (dz51验证)   MSN:dz51.com@163.com
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