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标题: PCI&LVDS产品开发平台(RPDP-PCI&LVDS) [打印本页]
作者: dz51demo    时间: 10.11.2007 09:12
标题: PCI&LVDS产品开发平台(RPDP-PCI&LVDS)
【产品价格】/ ?- [' j' f. a0 ~% ?  ~5 }
标准版: ￥2500
1 [4 Q1 ?  G4 T& A1 f
5 }5 m+ \7 i, \; j0 w【产品定位】/ J/ F1 G. X, a+ j. Y, z
基于PCI的高速数据采集卡开发
" r2 D( n& m+ k% m* T: _基于LVDS接口的高速数据采集处理卡；
6 O. t9 n" j, a0 `算法加速卡;
; d/ c- a1 ^* f# [; ?) a7 r. f. T# E" T7 G

/ p# M: m! W, z' D【产品特色】
: I6 M, q6 Q) M; w提供完整的FPGA+PCI解决方案，性能稳定,兼容性好；
* W7 n+ f& x: c, J5 p# a/ i提供完整的参考设计,包括FPGA代码,驱动程序,应用程序等,可以作为项目开发的模板;+ h  ]# W7 o3 `) y) j2 K: ^
扩展性能好，可以扩展音频输入输出卡，视频输入输出卡，高速AD，DA等。# L( L+ Q8 |2 r+ p" s0 {3 O- Q
1 w$ C' e) r- r, T
& H5 s- H, f: v& n6 Q4 l
【产品清单】3 `+ k: g9 `$ M/ W8 M) A
1、RPDP-PCI&LVDS开发板       1块/ j$ t9 Q- x2 t' |
2、ByteBlasterII 下载电缆    1条# `$ o1 @2 P8 @) O% M2 U$ O4 B
3、配套DVD光盘               1张  Z- Y2 L) p5 M, _1 c

- B( M! n. y+ v+ M+ {% G3 j" a+ ?: v, K' Z7 U$ z- B5 E" {
【硬件资源】
# X4 i0 D2 L2 ?' D3 T1、FPGA芯片：
0 i1 }- o1 V+ {      标准版：EP1C6Q240， 包括12,060LEs，相当于15万门左右
3 J  q4 E: a6 H      增强版：EP1C12Q240，包括12,060LEs，相当于30万门左右$ [$ T: h! O, u$ d
2、配置芯片：
4 z( c" r9 ?: I$ O+ A      增强版：EPCS1，1Mbit储存量，支持AS和JTAG两种配置模式
' h0 o% }% `2 m/ w      增强版：EPCS4，4Mbit储存量，支持AS和JTAG两种配置模式9 \" F0 z& r( E  d) A
3、8M Byte 高速SDARM) D4 |  K( N, M0 Z  G6 w& `. a
      一片2M×32Bit SDRAM ，4个Bank，最高166MHz读写速度；
' o! @9 G- }( F6 B, s8 Q4、LVDS扩展接口（DB62接口）, i% F4 L+ }0 j* E7 L
      同时提供提供：
) q8 X6 `3 f' Y5 B      12路LVDS信号输出；/ ?5 ?, B3 c3 I" A6 |
      12路LVDS信号输入；
$ z* q% {! f% s, [      12路LVTTL信号（输入输出可编程）
+ y8 e4 G: T$ S" ~! u% ?) D2 K( v7 i5 G, Y( t
5、RedLogic扩展接口（VME48接口）
' x0 s  `7 }" {! r/ d/ `      提供32路LVTTL信号，其中包括一路专用时钟输入和一路专用时钟输出.通过相应的扩展板，可以实现Video，Audio和高 速AD/DA等应用。用户也可以开发自己定义的接口板。3 }7 i5 p$ u* B+ B1 B
; |' Z- G. c( Z
【配套软件】
1 x; T9 l' G: c" _1、 相关开发工具软件6 F) d$ t& ]. l+ P! o
2、 开发实例及文档' K* D) O$ _) {. S# |
3、 FPGA和ASIC设计资源库
9 b, V+ S% g% y0 z' U- ~* P2 Q# ~9 z' }7 U/ d3 D
【设计文档】8 l2 U5 J$ W# e( b
1、开发板用户手册
+ P- {3 o" |6 g4 l2、开发板原理图和PCB（Protel99SE格式）
/ `0 E0 Q# w8 |# e$ L3、QuartusII和NIOSII IDE安装指导和入门教程
$ M9 Z: A0 ~& o0 W4 N4、主要芯片的数据手册和仿真模型（Verilog HDL语言描述）0 W( q% x* K) w5 h, n0 R/ ~0 J! i
+ Y0 _: R) V( w/ Z  y
【开发实例】9 U" F6 g3 n: D' q7 T
● BASE64解码算法; ]% x  E* A1 @  D% \: O$ H
        Base64编码
- s* p7 m8 Q7 R  q' ^+ n; n2 E        Base64是网络上最常见的用于传输8Bit字节代码的编码方式之一，大家可以查看RFC2045～RFC2049，上面有MIME的详细规范。% T( \( x8 x% V1 A
        Base64要求把每三个8Bit的字节转换为四个6Bit的字节（3*8 = 4*6 = 24），然后把6Bit再添两位高位0，组成四个8Bit的字节，也就是说，转换后的字符串理论上将要比原来的长1/3。! I( D/ D* E7 S# U5 _
        本设计完成了BASE64解码算法的FPGA程序设计和验证。
5 \% y9 r3 Q& j' p! K" ?* e7 w3 P, V" Z+ x
● 数据采集卡
& i1 k) S( Z/ E% F: x        FPGA内部产生数据源，主机端程序响应pci卡发出的中断信号，将硬件板卡中的数据传入主机，并将数据在界面上显示相应的数据以及接收到的帧数。将收到的数据存入硬盘，以便查看。! c" U! p3 u& y. w

' J% |2 r- f$ G3 X. j3 t* G
; h( O) \4 u0 }) ~
9 |+ ?- ?8 \: y/ M: s% V% [% r! h4 {6 N, l( `: ^
" [$ }5 v9 D7 C: L- ]* N0 a$ C5 M

* f1 J2 N0 V0 B/ d0 M
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) y; b2 E. }/ C; }4 x1 B电话:   010-51299598  62535108-11      FAX：010-62538108-17
5 S; K8 H( `. O; k6 \7 h. t- A0 C9 B- B         010-82625208        手机:13671276968  ( V9 @3 I4 S) p0 T9 ?( H
公司门市地址：北京市海淀区中发电子大厦2楼2112柜台  V/ c: q$ E3 W9 `. d) }: N# u2 R
网址: http://www.dz51.cn   http://www.dz51.com     ; g1 Q; f# @6 m5 C9 ^
E-Mail:  dz51.com@163.com   dz51123@sohu.com   dz51123@sina.com   sunjingyun488@sohu.com
6 X( X( h' N3 b: D( I) CQQ:349646210 (dz51验证)   MSN:dz51.com@163.com



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