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标题: PCI&LVDS产品开发平台(RPDP-PCI&LVDS) [打印本页]
作者: dz51demo    时间: 10.11.2007 09:12
标题: PCI&LVDS产品开发平台(RPDP-PCI&LVDS)
【产品价格】; u+ C# U/ x% C: G8 N# [. N8 m
标准版: ￥2500
; M- E4 `# Z* y5 C2 a! V
7 i. A. E8 k" J6 m( t5 [【产品定位】
6 I& \4 c0 \  {基于PCI的高速数据采集卡开发4 R# Q9 Y/ c1 ]" K  x% o5 k
基于LVDS接口的高速数据采集处理卡；* n4 a* r- ]3 }1 z
算法加速卡;2 a# x* X% u+ M" M  A

- g5 h! p  D( @% \! Y
0 ?+ w) I( Y: _. P1 b; Y8 d) P+ E+ i【产品特色】: b0 g! p- X; J' j0 U2 r
提供完整的FPGA+PCI解决方案，性能稳定,兼容性好；
$ t, L+ a8 N2 ]+ e: W$ x提供完整的参考设计,包括FPGA代码,驱动程序,应用程序等,可以作为项目开发的模板;
* Z; ]2 g, h8 {- S扩展性能好，可以扩展音频输入输出卡，视频输入输出卡，高速AD，DA等。+ B- |5 F5 e$ c: D
) y9 H) L9 P5 N

; F- l  J6 c7 v0 C& a【产品清单】5 V7 ?: q% b) @% R* R$ Z' @0 I  w
1、RPDP-PCI&LVDS开发板       1块
( @1 Q- a* B: m' U2、ByteBlasterII 下载电缆    1条
8 O6 w3 @2 l- f* E: M! ~3、配套DVD光盘               1张$ K2 c7 y! J0 E( x- i

. M0 a8 N  y' T6 Y1 }* Z
8 P. e( @  ~* G. M: [【硬件资源】
6 q' I7 r( r( J: R, R+ x1、FPGA芯片：8 w  @0 O3 K7 Q- t. y* h: F
      标准版：EP1C6Q240， 包括12,060LEs，相当于15万门左右
! q, _6 d$ h& y. J! \, ]6 k      增强版：EP1C12Q240，包括12,060LEs，相当于30万门左右
6 l" I2 u* U" H6 o( U/ g+ l2、配置芯片：+ @$ ?0 A, B3 W# t
      增强版：EPCS1，1Mbit储存量，支持AS和JTAG两种配置模式. Y& x& X$ L% }% `6 t* J
      增强版：EPCS4，4Mbit储存量，支持AS和JTAG两种配置模式* u8 o5 k+ @6 b/ j, P' g+ S
3、8M Byte 高速SDARM& u4 v" O6 D1 }- P$ b4 O
      一片2M×32Bit SDRAM ，4个Bank，最高166MHz读写速度；. e: {: X. D9 l2 Q1 @
4、LVDS扩展接口（DB62接口）$ a  b, h! B* e) k: r2 z$ o/ f! }
      同时提供提供：& [7 z" D9 E$ ^) C8 C1 [% `
      12路LVDS信号输出；
' P7 i9 F6 C9 G* k( A. Y      12路LVDS信号输入；/ q. f8 z' {8 R" J3 Q8 ]/ u
      12路LVTTL信号（输入输出可编程）
/ K( n4 j( {! q/ W1 o4 V! d( j2 o' M  w7 d
5、RedLogic扩展接口（VME48接口）
; O: {& ^& t4 I' y$ b: n      提供32路LVTTL信号，其中包括一路专用时钟输入和一路专用时钟输出.通过相应的扩展板，可以实现Video，Audio和高 速AD/DA等应用。用户也可以开发自己定义的接口板。
; k9 T: S  {# F, z( N! Y' P
% ]( n: T9 X- F' E【配套软件】
/ i- e6 X9 X( L0 [1、 相关开发工具软件: o4 W* ?' m- d9 P: U
2、 开发实例及文档* ]  c* t+ A, i) Y# ~) }' `
3、 FPGA和ASIC设计资源库
, }1 S" k9 r# |
) P- J  _  y& m6 Z8 c  m0 P( ~) _【设计文档】+ [3 ~4 N6 h. o: X0 R( r. r
1、开发板用户手册
& q$ c- s5 H( S  `5 k0 y# U9 a2、开发板原理图和PCB（Protel99SE格式）. e1 R% Y' ?+ K8 U" N3 i/ A- s
3、QuartusII和NIOSII IDE安装指导和入门教程
) T: \+ R0 q5 R4、主要芯片的数据手册和仿真模型（Verilog HDL语言描述）1 i0 B: F7 _7 X! B# Q  [
# L7 C) }! a$ x# T% k* P
【开发实例】2 D5 b* V5 R* I, t' U: M+ y/ H0 n
● BASE64解码算法- j5 A6 {2 F( l. t. A" W' ~6 R2 b
        Base64编码   @- d  G) ?6 C& K% n
        Base64是网络上最常见的用于传输8Bit字节代码的编码方式之一，大家可以查看RFC2045～RFC2049，上面有MIME的详细规范。
& S0 }0 i( [& }# T6 B        Base64要求把每三个8Bit的字节转换为四个6Bit的字节（3*8 = 4*6 = 24），然后把6Bit再添两位高位0，组成四个8Bit的字节，也就是说，转换后的字符串理论上将要比原来的长1/3。
  z- P! j6 g( \- |$ |& M; z        本设计完成了BASE64解码算法的FPGA程序设计和验证。
2 X( L- C1 x5 y6 ]$ l$ ~
: H( M1 ^" j& v6 H( t8 ^8 J. C# r ● 数据采集卡% o- S( N; G" Y. G2 U$ a5 T- U  {- k. ~
        FPGA内部产生数据源，主机端程序响应pci卡发出的中断信号，将硬件板卡中的数据传入主机，并将数据在界面上显示相应的数据以及接收到的帧数。将收到的数据存入硬盘，以便查看。
5 u- F8 |) I4 K- ^; W  X; h3 p$ n, H* b5 P: e) A

5 J1 u1 P0 U% J* o2 T
/ k4 g4 H. `8 [5 Q
* @$ W2 |0 q, ^! W4 H: F4 Y ; ~* ~" D" q+ i) A+ @; I
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特别声明：' Y% z3 g2 [. ]9 `. b* ?
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, Y' P9 C! b; O& E# ^3 A网址:/xw/bzxw/200602/198.asp查看  如何汇款购买请点这里% z  i! m$ ?) m) n$ s5 U) Z! u6 N
详细情况也可拨打电话咨询：. t( a& C* V/ ?- A5 _
电话:   010-51299598  62535108-11      FAX：010-62538108-17% M# N$ O4 @6 a8 i- L7 D. S
         010-82625208        手机:13671276968  1 c1 F9 L+ z, Q
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E-Mail:  dz51.com@163.com   dz51123@sohu.com   dz51123@sina.com   sunjingyun488@sohu.com
* X9 ~4 y+ t; C5 [& g3 ]. I. w8 _) sQQ:349646210 (dz51验证)   MSN:dz51.com@163.com



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